浙江数字信号测试参考价格

采用同步时钟的电路减少了出现逻辑不确定状态的可能性，而且可以减小电路和信号布线时延的累积效应，所以在现代的数字系统和设备中***采用。采用同步电路以后，数字电路就以一定的时钟节拍工作，我们把数字信号每秒钟跳变的比较大速率称为信号的数据速率(BitRate),单位通常是bps(bitspersecond)或者bit/s。大部分并行总线的数据速率和系统中时钟的工作频率一致，比如某51系列单片机工作在11.0592MHz时钟下，其数据线上的数据速率就是11.0592Mbps;也有些特殊的场合采用DDR方式(DoubleDataRate)采样，数据速率是其时钟工作频率的2倍，比如某DDR4内存芯片，其工作时钟是1333MHz,其数据速率是2666Mbps。还有些高速传输的情况，比如PCle、USB3.0、SATA、RapidIO、100G以太网等总线，时钟信息是通过编码嵌入在数据流中，这种情况下虽然在外部看不到有专门的时钟传输通道，但是其工作起来仍然有特定的数据速率。数字信号电平范围象征的逻辑状态；浙江数字信号测试参考价格

数据经过8b/10b编码后有以下优点：

(1)有足够多的跳变沿，可以从数据中进行时钟恢复。正常传输的数据中可能会有比较长的连续的0或者连续的1,而进行完8b/10b编码后，其编码规则保证了编码后的数据流中不会出现超过5个连续的0或1,信号中会出现足够多的跳变沿，因此可以采用嵌入式的时钟方式，即接收端可以从数据流中通过PLL电路直接恢复时钟，不需要专门的时钟传输通道。

(2)直流平衡，可以采用AC耦合方式。经过编码后数据中不会出现连续的0或者1, 但还是有可能在某个时间段内0或者1的数量偏多一些。从上面的编码表中我们可以看 到，同一个Byte对应有正、负两组10bit的编码， 一个编码中1的数量多一些，另一个编码中 0 的数量多一些。数据在对当前的Byte进行8b/10b编码传输时，会根据前面历史传输的 数据中正负bit的数量来选择使用哪一组编码，从而可以保证总线上正负bit的数量在任何 时刻基本都是平衡的，也就是直流点不会发生大的变化。直流点平衡以后，在信号传输的路 径上我们就可以采用AC耦合方式(常用的方法是在发送端或接收端串接隔直电容),这  样信号对于收发端的地电平变化和共模噪声的抵抗能力进一步增强，可以传输更远的距离。 上海PCI-E测试数字信号测试数字信号上升时间是示波器中进行上升时间测量例子，光标交叉点指示出上升时间测量的起始点和结束点的位置；

数字信号并行总线与串行总线(Parallel and Serial Bus)

虽然随着技术的发展，现代的数字芯片已经集成了越来越多的功能，但是对于稍微复杂  一点的系统来说，很多时候单独一个芯片很难完成所有的工作，这就需要和其他芯片配合起  来工作。比如现在的CPU的处理能力越来越强，很多CPU内部甚至集成了显示处理的功  能，但是仍然需要配合外部的内存芯片来存储临时的数据，需要配合桥接芯片扩展硬盘、 USB等接口；现代的FPGA内部也可以集成CPU、DSP、RAM、高速收发器等，但有些  场合可能还需要配合用的DSP来进一步提高浮点处理效率，配合额外的内存芯片来扩展  存储空间，配合用的物理层芯片来扩展网口、USB等，或者需要多片FPGA互连来提高处  理能力。所有这一切，都需要用到相应的总线来实现多个数字芯片间的互连。如果我们把  各个功能芯片想象成人体的各个功能，总线就是血脉和经络，通过这些路径，各个功能  模块间才能进行有效的数据交换和协同工作。

建立时间和保持时间加起来的时间称为建立/保持时间窗口，是接收端对于信号保持在 同一个逻辑状态的**小的时间要求。数字信号的比特宽度如果窄于这个时间窗口就肯定无 法同时满足建立时间和保持时间的要求，所以接收端对于建立/保持时间窗口大小的要求实 际上决定了这个电路能够工作的比较高的数据速率。通常工 作速率高一些的芯片，很短的建 立时间、保持时间就可以保证电路可靠工作，而工作速率低一 些的芯片则会要求比较长的建 立时间和保持时间。

另外要注意的是， 一个数字电路能够可靠工作的比较高数据速率不仅取决于接收端对于 建立/保持时间的要求，输出端的上升时间过缓、输出幅度偏小、信号和时钟中有抖动、信号 有畸变等很多因素都会消耗信号建立/保持时间的裕量。因此一个数字电路能够达到的比较高数据传输速率与发送芯片、接收芯片以及传输路径都有关系。

建立时间和保持时间是数字电路非常重要的概念，是接收端可靠信号接收的**基本要 求，也是数字电路可靠工作的基础。可以说，大部分数字信号的测量项目如数据速率、信号 幅度、眼图、抖动等的测量都是为了间接保证信号满足接收端对建立时间和保持时间的要 求，在以后章节的论述中我们可以慢慢体会。 幅度测量是数字信号常用的测量，也是很多其他参数侧鲁昂的基础。

数字信号测试串行总线的8b/10b编码(8b/10bEncoding)

前面我们介绍过，使用串行比并行总线可以节省更多的布线空间，芯片、电缆等的尺寸可以做得更小，同时传输速率更高。但是我们知道，在很多数字系统如CPU、DSP、FPGA等内部，进行数据处理的小单位都是Byte,即8bit,把一个或多个Byte的数据通过串行总线可靠地传输出去是需要对数据做些特殊处理的。将并行数据转换成串行信号传输的简单的方法如图1.19所示。比如发送端的数据宽度是8bit,时钟速率是100MHz,我们可以通过Mux(复用器)芯片把8bit的数据时分复用到1bit的数据线上，相应的数据速率提高到800Mbps(在有些LVDS的视频信号传输中比较常用的是把并行的7bit数据时分复用到1bit数据线上)。信号到达接收端以后，再通过Demux(解复用器)芯片把串行的信号分成8路低速的数据。 数字信号处理技术经过几十年的发展已经相当成熟，目前在很多领域都有着宽敞的应用。上海PCI-E测试数字信号测试

传输线对数字信号的影响；浙江数字信号测试参考价格

对于并行总线来说，更致命的是这种总线上通常挂有多个设备，且读写共用，各种信号分叉造成的反射问题使得信号质量进一步恶化。

为了解决并行总线占用尺寸过大且对布线等长要求过于苛刻的问题，随着芯片技术的发展和速度的提升，越来越多的数字接口开始采用串行总线。所谓串行总线，就是并行的数据在总线上不再是并行地传输，而是时分复用在一根或几根线上传输。比如在并行总线上 传输1Byte的数据宽度需要8根线，而如果把这8根线上的信号时分复用在一根线上就可 以减少需要的走线数量，同时也不需要再考虑8根线之间的等长关系。 浙江数字信号测试参考价格

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